A.0x35363738
B.0x36353837
C.0x38373635
D.0x37383536
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A.PSP
B.MSP
C.SPSR
D.CPSR
A.ARM處理器的工作狀態(tài)包括ARM狀態(tài)和Thumb狀態(tài)兩種
B.ARM狀態(tài)支持16位指令寬度也支持32位指令寬度
C.Thumb狀態(tài)或Thumb-2狀態(tài)下,代碼密度低于ARM狀態(tài),占用存儲空間變大
D.ARM處理器復位后自動進入ARM狀態(tài)
A.ARM處理器采用CISC和RISC相結(jié)合的結(jié)構(gòu)
B.嵌入式處理器都采用哈佛結(jié)構(gòu)
C.ARM處理器具有耗電省、功能強、成本低等特點
D.ARM處理器內(nèi)部的總線標準是PCIExpress
A.IP地址
B.MAC地址
C.有效載荷
D.校驗信息
A.0.3
B.0.5
C.1
D.1.5
最新試題
74138譯碼器通常用于產(chǎn)生片選信號,其譯碼輸入端應與系統(tǒng)的()總線相連。
某顯示器最高分辨率為1024×768、24位真彩,其所需最小緩存是()
以下對動態(tài)RAM描述正確的是()
NANDFLASH和NORFLASH的區(qū)別正確的是()
下面不符合嵌入式操作系統(tǒng)特點的是()
與存儲器映像編制方式相比,I/O端口的獨立編址方式具有()特點。
以下敘述中,不符合RICS特征的是()
微處理器地址總線寬度為32位,則其內(nèi)部數(shù)據(jù)總線的寬度()
在嵌入式ARM處理器中,下面哪種中斷方式優(yōu)先級最高()
設(shè)異步串行接口電路中波特率因子為64,則接收端在確定起始位后應每隔()個時鐘周期對串行數(shù)據(jù)接收線采樣一次。