A.20uA
B.40uA
C.1.6mA
D.16mA
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A.0.3V
B.0.5V
C.0.8v
D.1.2V
A.tD
B.tR
C.tS
D.tF
A.變低
B.不變
C.變高
D.加倍
最新試題
()在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用,其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線(xiàn)。
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線(xiàn)數(shù)n的關(guān)系一般為()
簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
27系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案,比較各種方案的特點(diǎn)。如果用HDPLD來(lái)實(shí)現(xiàn),設(shè)計(jì)方案是最佳嗎?簡(jiǎn)述理由。
與倒T形電阻網(wǎng)絡(luò)DAC相比,權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了()對(duì)轉(zhuǎn)換精度的影響。
以下哪個(gè)編碼不能是二-十進(jìn)制譯碼器的輸入編碼()
用1M×4的DRAM芯片通過(guò)()擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
具有“有1出0、全0出1”功能的邏輯門(mén)是()
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。