單項(xiàng)選擇題N個(gè)觸發(fā)器可以構(gòu)成能寄存()位二進(jìn)制數(shù)碼的寄存器。
A.N-1
B.N
C.N+1
D.2N
您可能感興趣的試卷
你可能感興趣的試題
1.單項(xiàng)選擇題下列邏輯電路中為時(shí)序邏輯電路的是()。
A.變量譯碼器
B.加法器
C.數(shù)碼寄存器
D.數(shù)據(jù)選擇器
2.單項(xiàng)選擇題把一個(gè)五進(jìn)制計(jì)數(shù)器與一個(gè)四進(jìn)制計(jì)數(shù)器串聯(lián)可得到()進(jìn)制計(jì)數(shù)器。
A.4
B.5
C.9
D.20
3.單項(xiàng)選擇題同步計(jì)數(shù)器和異步計(jì)數(shù)器比較,同步計(jì)數(shù)器的顯著優(yōu)點(diǎn)是()。
A.工作速度高
B.觸發(fā)器利用率高
C.電路簡單
D.不受時(shí)鐘CP控制
4.單項(xiàng)選擇題下列觸發(fā)器中,沒有約束條件的是()。
A.基本RS觸發(fā)器
B.主從RS觸發(fā)器
C.同步RS觸發(fā)器
D.邊沿D觸發(fā)器
5.單項(xiàng)選擇題邊沿式D觸發(fā)器是一種()穩(wěn)態(tài)電路。
A.無
B.單
C.雙
D.多
最新試題
雙積分型數(shù)字電壓表是否需要取樣-保持電路?請(qǐng)說明理由。
題型:問答題
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
題型:單項(xiàng)選擇題
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
題型:單項(xiàng)選擇題
TTL與非門輸出低電平的參數(shù)規(guī)范值是()
題型:單項(xiàng)選擇題
簡述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
題型:問答題
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體?是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體?簡述它們的作用。
題型:問答題
如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。
題型:單項(xiàng)選擇題
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是()可擦除的。
題型:單項(xiàng)選擇題
什么是觸發(fā)器的空翻現(xiàn)象,如何避免空翻?
題型:問答題
以下代碼中為無權(quán)碼的為()。
題型:單項(xiàng)選擇題