A.對(duì)差模信號(hào)起抑制作用
B.對(duì)共模信號(hào)起抑制作用
C.對(duì)差模信號(hào)和共模信號(hào)均無作用
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A.電阻阻值有誤差
B.晶體管參數(shù)的分散性
C.晶體管參數(shù)受溫度影響
D.受輸入信號(hào)變化的影響
A.有效放大差模信號(hào)，有力抑制共模信號(hào)
B.既放大差模信號(hào)，又放大共模信號(hào)
C.有效放大共模信號(hào)，有力抑制差模信號(hào)
D.既抑制差模信號(hào)，又抑制共模信號(hào)。
A.增加一倍
B.減小一半
C.不變
D.按指數(shù)規(guī)律變化
A.高輸入電阻，高輸出電阻，高增益
B.高輸入電阻，低輸出電阻，高增益
C.高輸入電阻，低輸出電阻，低增益
D.低輸入電阻，低輸出電阻，低增益
A.差模放大倍數(shù)值增大
B.差模輸入電阻增大
C.抑制共模信號(hào)能力增強(qiáng)
最新試題
?電路如圖所示，如果電容C2開路，則MOSFET的漏極直流電壓將會(huì)（），漏極交流電壓將會(huì)（），增益將會(huì)（）。
?TTL或非門組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象？（）
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義，VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是（）。
CG放大器具有較（）的輸入電阻和較（）的輸出電阻。?
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
一塊通用面包板，公共條是三?四?三分段連通型，那么這塊板上最多有（）個(gè)插孔在內(nèi)部是連通在一起的。
?CS放大器中引入源極電阻RS，其作用有（）。?
?10進(jìn)制計(jì)數(shù)器模塊在數(shù)字鐘系統(tǒng)中可作為以下哪些模塊的子模塊？（）
以下哪個(gè)MOS放大器組態(tài)結(jié)構(gòu)最適合用在電壓信號(hào)處理系統(tǒng)的最后一級(jí)？?（）
假設(shè)NEMOSFET已工作在飽和區(qū)，若uDS繼續(xù)增大時(shí)，溝道夾斷點(diǎn)向漏極移動(dòng)。