A.半導(dǎo)體數(shù)碼管
B.液晶數(shù)碼管
C.熒光數(shù)碼管
D.輝光數(shù)碼管
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A.8-3譯碼器
B.2-4譯碼器
C.4-16譯碼器
D.3-8譯碼器
A.共發(fā)射極
B.共集電極
C.共陰極
D.共陽(yáng)極
A.8421BCD編碼器
B.二進(jìn)制編碼器
C.十進(jìn)制編碼器
D.二-十進(jìn)制編碼器
A.數(shù)字電路
B.模擬電路
C.組合邏輯電路
D.時(shí)序邏輯電路
A.卡諾圖中有2個(gè)1格相鄰,可以消去1個(gè)互反變量
B.卡諾圖中有4個(gè)1格相鄰,可以消去2個(gè)互反變量
C.卡諾圖中有8個(gè)1格相鄰,可以消去4個(gè)互反變量
D.卡諾圖中有16個(gè)1格相鄰,可以消去8個(gè)互反變量
最新試題
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是()。
一個(gè)兩輸入端的門電路,當(dāng)輸入為10時(shí),輸出不是1的門電路為()
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體?是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體?簡(jiǎn)述它們的作用。
7系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
TTL與非門閾值電壓UT的典型值是()
具有“有1出0、全0出1”功能的邏輯門是()
什么是觸發(fā)器的空翻現(xiàn)象,如何避免空翻?
TTL與非門輸出高電平的參數(shù)規(guī)范值是()