判斷題電路中只要引入負(fù)反饋就可以改善電路的性能。
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5.單項選擇題需要一個阻抗變換電路，要求輸入電阻大，輸出電阻小，應(yīng)選用（）負(fù)反饋。
A.電壓串聯(lián)
B.電壓并聯(lián)
C.電流串聯(lián)
D.電流并聯(lián)
最新試題
一塊通用面包板，公共條是三?四?三分段連通型，那么這塊板上最多有（）個插孔在內(nèi)部是連通在一起的。
題型：單項選擇題
?CD放大器的性能特征有（）。?
題型：多項選擇題
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義，VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是（）。
題型：單項選擇題
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號均通過電容耦合進(jìn)行傳輸（注意圖中未畫出電容），要實現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
題型：單項選擇題
在對數(shù)字鐘計時、校時模塊進(jìn)行仿真時，設(shè)秒信號的周期為10ns，若要觀察24時制計數(shù)是否正確，那么在復(fù)位信號無效，計時使能信號有效的情況下，仿真需運行多長時間？（）
題型：單項選擇題
?在使用verilog描述一個二選一的數(shù)據(jù)選擇器時，使用一條語句來進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語句對應(yīng)的是（）。
題型：單項選擇題
CG放大器具有較（）的輸入電阻和較（）的輸出電阻。?
題型：單項選擇題
已知某N溝道增強(qiáng)型MOS場效應(yīng)管的。下表給出了四種狀態(tài)下和的值，那么各狀態(tài)下器件的工作狀態(tài)為（）。
題型：多項選擇題
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
題型：多項選擇題
CG放大器因其輸入電阻過小，因此沒什么用處。
題型：判斷題