A.D觸發(fā)器
B.JK觸發(fā)器
C.基本RS觸發(fā)器
D.負(fù)邊沿觸發(fā)D觸發(fā)器
您可能感興趣的試卷
你可能感興趣的試題
A.延遲時(shí)間
B.保持時(shí)間
C.建立時(shí)間
D.轉(zhuǎn)換時(shí)間
A.JK觸發(fā)器
B.D觸發(fā)器
C.T觸發(fā)器
D.基本RS觸發(fā)器
A.3個(gè)
B.4個(gè)
C.5個(gè)
D.6個(gè)
A.64
B.6
C.8
D.32
A.64
B.4
C.8
D.32
最新試題
一塊通用面包板，公共條是三?四?三分段連通型，那么這塊板上最多有（）個(gè)插孔在內(nèi)部是連通在一起的。
?數(shù)字頻率計(jì)設(shè)計(jì)中的測(cè)頻計(jì)數(shù)模塊共有多少個(gè)狀態(tài)？（）
?CS、CG和CD三種組態(tài)中，最適合做電壓放大器的還是CS放大器。
當(dāng)VGS=0時(shí)，能夠?qū)ǖ腗OS管為（）
CD放大器因?yàn)樵礃O輸出信號(hào)幾乎與柵極輸入信號(hào)變化一致，因此被稱(chēng)為“源極跟隨器”。
CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
?CG放大器的性能描述合理的是（）。
可以通過(guò)新增以下哪些類(lèi)型文件添加ChipScope調(diào)試IP核？（）
?某次電路實(shí)驗(yàn)中，一同學(xué)按如下電路圖連接電路，完成實(shí)驗(yàn)。其中D0，D1端為輸入端，S0與S1為輸出端。在實(shí)驗(yàn)過(guò)程中，該同學(xué)觀測(cè)到輸出端S0，S1端輸出電平分別為邏輯高電平，邏輯低電平。請(qǐng)問(wèn)此刻電路輸入端D0，D1電平可能分別為（）。
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí)，使用一條語(yǔ)句來(lái)進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語(yǔ)句對(duì)應(yīng)的是（）。