已知某直流穩(wěn)壓電源電路如圖所示。設(shè)三極管的發(fā)射結(jié)導(dǎo)通電壓UBE（on）=0.7V，變壓器副邊繞組電壓有效值為20V。
（1）求輸出電壓UO的調(diào)節(jié)范圍。
（2）當(dāng)電位器RW調(diào)至中間位置時(shí)，估算UA、UO的數(shù)值。
（3）當(dāng)電網(wǎng)電壓升高時(shí)，說明輸出電壓穩(wěn)定的過程。
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?某次電路實(shí)驗(yàn)中，一同學(xué)按如下電路圖連接電路，完成實(shí)驗(yàn)。其中D0，D1端為輸入端，S0與S1為輸出端。在實(shí)驗(yàn)過程中，該同學(xué)觀測(cè)到輸出端S0，S1端輸出電平分別為邏輯高電平，邏輯低電平。請(qǐng)問此刻電路輸入端D0，D1電平可能分別為（）。
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為（）。
CG放大器因其輸入電阻過小，因此沒什么用處。
?電路如圖所示，如果電容C2開路，則MOSFET的漏極直流電壓將會(huì)（），漏極交流電壓將會(huì)（），增益將會(huì)（）。
?CG放大器的性能描述合理的是（）。
在下圖中如果輸入輸出均有電容耦合，則將RG的阻值由10MΩ替換為1MΩ時(shí)，柵極直流電壓將會(huì)（），漏極直流電流將會(huì)（），輸入電阻將會(huì)（）。
在對(duì)數(shù)字鐘計(jì)時(shí)、校時(shí)模塊進(jìn)行仿真時(shí)，設(shè)秒信號(hào)的周期為10ns，若要觀察24時(shí)制計(jì)數(shù)是否正確，那么在復(fù)位信號(hào)無效，計(jì)時(shí)使能信號(hào)有效的情況下，仿真需運(yùn)行多長時(shí)間？（）
CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
?在verilogHDL的數(shù)字表達(dá)方式用，和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有（）。
CD放大器因?yàn)樵礃O輸出信號(hào)幾乎與柵極輸入信號(hào)變化一致，因此被稱為“源極跟隨器”。