A.飽和區(qū)和放大區(qū)
B.放大區(qū)和截止區(qū)
C.飽和區(qū)和截止區(qū)
D.集電區(qū)和發(fā)射區(qū)
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B.可編程陣列邏輯
C.通用陣列邏輯
D.專(zhuān)用陣列邏輯
A.與非與非
B.異或
C.最簡(jiǎn)與或
D.最簡(jiǎn)或與
A.PROM
B.EPROM
C.SRAM
D.PLA
A.與門(mén)陣列
B.或門(mén)陣列
C.與非門(mén)陣列
D.輸入緩沖器
最新試題
TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是()
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個(gè)()。
ROM可以用來(lái)存儲(chǔ)程序、表格和大量固定數(shù)據(jù),但它不可以用來(lái)實(shí)現(xiàn)()。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。
TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是()
簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT,c是INTEGER,執(zhí)行c<=a+b。
7系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
以下代碼中為無(wú)權(quán)碼的為()。
與倒T形電阻網(wǎng)絡(luò)DAC相比,權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了()對(duì)轉(zhuǎn)換精度的影響。